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【单选题】

对数字集成电路来讲,信号传播时间和高低电平转换时间不会完全被消除掉,那么,就这两者而言,可能诱发数字电路输出信号暂短逻辑错误的可能原因是( )。

A.
信号的传播时间
B.
信号的传播时间,及从输入到输出各路输入信号历经的逻辑门数量不等
C.
高低电平转换时间
D.
高低电平转换时间,及从输入到输出各路输入信号历经的逻辑门数量不等
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参考答案:
举一反三

【多选题】与模拟电路相比,数字电路主要的优点有

A.
电路结构简单,便于集成化。
B.
工作可靠,抗干扰能力强。
C.
数字信息便于长期保存和加密。
D.
数字集成电路产品系列全,通用性强,成本低。
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